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• 【題組】⑷以上三個方法所得到的平均等待時間（average waiting time）大小順序依序為何？
• 五、在精簡指令集計算機（RISC, Reduced Instruction Set Computer）設計中：【題組】⑴同時配備有指令快取記憶體（instruction cache memory）及數
• 二、效能一般指的是計算機執行機器碼程式時的速度，通常以所需的時間來反映。相關計算式如下：程式執行時間=執行的機器指令數 ×平均每道指令所花費時脈數 ×時脈週期【題組】⑴透過編譯器與組譯器（assemb
• 五、在快取記憶體（cache memory）的設計中，其效能評估的數學式是AMAT(average memory access time)=HT(hit time)+MR(miss rate)×MP(
• 50. 對於學校教材之編寫與使用，何者不是性別平等教育法所規範的內容？(A) 教材內容應呈現多元之性別觀點(B) 教材內容應平衡反映不同性別之歷史貢獻(C) 教材內容應平衡反映不同性別之生活經驗(D)
• 三、某計算機其記憶空間為 232個位址，每個位址可存放一位元組（byte）；其虛擬記憶體系統（virtual memory system）之頁（page）大小為 4KB（kilo bytes），主記憶
• 【題組】⑵程式中那些類別的指令會用到指令快取記憶體？那些類別的指令會用到數據快取記憶體？並分別具體舉例說明之。請儘量用專業的指令類別名稱答題。（7 分）
• 【題組】⑵透過積體電子技術無法改善上式中那些參數？並扼要說明之。（7 分）
• 【題組】⑵何者有助於降低 miss rate？（8 分)
• 【題組】⑵頁表（page table）內的項目（entries）數為何？（假設此頁表為單層的結構，並基於完整的頁表來回答本題。）
• 【題組】⑶設程式執行時對指令快取記憶體及數據快取記憶體的存取數比例為 2：1，且在理想快取設計下的每道指令時脈數（CPI）為 1。若實際情況下指令快取記憶體的錯失率（miss rate）為 20%，錯
• 【題組】⑶若機器碼程式共執行了 1010道指令，其中 45%為數據處理（data processing）類指令，其平均每道指令所花費時脈數為 1.5；30%為數據搬移（data movement）類指
• 【題組】⑶何者有助於降低 miss penalty？（6 分)
• 【題組】⑵一般而言，一個運算元指令集架構的加法運算指令應分別自何處、取得幾個運算元？運算結果應儲存於何處？
• 【題組】⑶此頁表應如何存取？亦即，應如何決定需要的項目何在？
• 三、在處理器的設計中：【題組】⑴一般是如何定義出字元（word）的大小？（6 分）
• 【題組】⑶一般而言，二個運算元指令集架構的加法運算指令應分別自何處、取得幾個運算元？運算結果應儲存於何處？
• 【題組】⑷何謂頁錯誤（page fault）？發生時，一般將由系統中那一個機制來處理？
• 【題組】⑵若稱其記憶體空間有 4 GB（G 表 giga 或稱為接近 109 的 2 的整數次方值；B 表byte），則一般稱其為幾個位元的架構？（7 分）
• 四、圖三所示為一由太空火箭塔台所簡化而成的集中質量結構系統，其前面兩個振態之振動頻率 ω 及振態（Mode Shapes）Φ 如圖所示。在忽略結構阻尼且僅考慮前面兩個振態之穩態反應（Steady-st
• 【題組】⑷一般而言，四個運算元指令集架構的加法運算指令其第四個運算元的作用為何？
• 四、某機器碼（machine code）在一個精簡指令集計算機（reduced instruction set computer,RISC）的管線式執行（pipelined execution）下，共
• 2 特許出願人は、拒絶査定に対して不服がある場合、理由書を備え、いつまでに再審査の請求をしなけ ればならないか。(A)査定書の送達から 2 ヶ月以内(B)特許公開から 15 ヶ月以内(C)査定書の送達
• 【題組】⑶何謂管線化（pipelined）的指令執行方式？何謂超純量（superscalar）的指令執行方式？（7 分）